单项选择题
假设某CPU的基本总线周期有4个状态,分别为T
1
、T
2
、T
3
、T
4
。系统规定,在 T
2
开始时发读写命令,在T
4
开始时信息要读出到数据总线或写入到存储体。为适应访问慢速存储体的需要,必须在原4个状态中,固定插入一个等待状态T
w
,则T
w
应插在( )。
A.T
1
之前
B.T
1
之后T
2
之前
C.T
3
之后T
4
之前
D.T
4
之后
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